A Java-enabled DSP - Computer Engineering Publications Database

 
 
           



        
   
                  
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Translated Instruction Window

Decoder

Dynamic Java Translation

Local Retire

idx Regs Compounding Scheduler

+ Prefetch Icache

Local Issue

Global Scheduler

Global Issue

Context 0

Context N

Registers

Registers

Exec Unit 0

Exec Unit M

Global Retire I/D Cache

Control Unit Link Translation Buffer

- Thread Schedule - Class Resolution - Synchronization

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Memory

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V: Valid Bit M: Modified Bit

Register File

Offset Disp Registers od0

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Stack Area Cached In Register File Current Cache Pointer

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it

+

Physical Register Files Are Located In Globally Addressable Region

5-bit Adders

Physical Index And Tag Registers Are Located Within Contexts

Overflow Underflow

Start Of Stack

Update Offset Register

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